DS861PP3
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CS5346
slr
t
SDOUT
SCLK
Output
LRCK
Output
sdo
t
slr
t
SDOUT
SCLK
Input
LRCK
Input
sdo
t
sclkh
t
sclkl
t
sclkw
t
Figure 1. Master Mode Serial Audio Port Timing
Figure 2. Slave Mode Serial Audio Port Timing
Figure 3. Format 0, 24-Bit Data Left-Justified
LRCK
SCLK
SDATA
+3 +2 +1
+5 +4
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
MSB
-1 -2 -3 -4
Channel A - Left
Channel B - Right
LSB
MSB
Figure 4. Format 1, 24-Bit Data IS
LRCK
SCLK
SDATA
+3 +2 +1
+5 +4
MSB
-1 -2 -3 -4 -5
+3 +2 +1
+5 +4
-1 -2 -3 -4
Channel A - Left
Channel B - Right
LSB
MSB
LSB
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